mprfgen は、VHDL の設計に使用することができます型マルチポート メモリ ジェネレーターです。ジェネリックまたはザイリンクス固有 (を介してコンポーネントのインスタンス化) マルチポート メモリのいずれかを生成できます。
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Tavernaは、純Javaオブジェクトモデル、モデルの事前準備のためのパーサー、( ワークフローを対応アプリケーションにドロップするためのSwingコンポーネントを含む)ビューとコントローラのセットを備えたScufl(簡易概念統一フロー言語)と呼ばれる高級言語を含むワークフロー制定と記述コンポーネントのコレクションです。実際にワークフローを実行するため、myGridワークフロー制定エンジンも必要です。
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VIPEC は、電気ネットワーク、ネットワーク ・ アナライザーです。電気ネットワークの説明し周波数領域における回路応答のシミュレーションを実行します。出力 2 ポート パラメーターの形式であり、グリッドやスミスチャート形式で印刷することができます。VIPEC は各種の集中定数回路素子として送電線と 2 ポート データ ファイルのような要素をサポートします。
PEP は並行システムのモデル化と検証フレームワークです。さまざまなモデリング言語の多数を提供しています (例えば SDL, B (PN) ^2, ペトリネット, プロセス代数と有限オートマトン)、および検証技術 (到達可能性と時相論理のモデル チェック)。その Tcl/Tk ベースの GUI による PEP は他の解析や仕様のツールを簡単に拡張可能です。フレームワークは完全に統合されたシミュレーションおよびすべてのレベルでデバッグ機能を提供しています。
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Dinotraceは信号波形のグラフィカルビューアです。これは、ASCII文字に簡単に加えてサポートして出力からのVerilogシミュレータで、他のと、VCSはそれは、コードまたはC Verilogのbackannotatedにソースが含まれれる値は、EmacsモードのためのGNUできる信号。
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YaPIDE は、Linux (およびおそらく他の Unix) 完全に注目のマイクロ チップ PIC シミュレータを目指しています。それは RAM、ROM、スタック、ブレークポイントやウォッチ ポイントのためのビューアーを提供しますとインライン (ASM) をデバッグ ソース エディターを持つ GUI です。現在サポートされているチップは、16F628 (部分) です。
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PyspiceはPythonで書かれた容易に拡張できるSPICEのプリプロセッサーで 少々精度が低下しますが、シミュレーション時間の削減をするためのものです. これは John Sheahanの spicepp とそこで開発されたモジュールとネットリストの拡張メソッドに触発されたものです. 主に、レイアウトの展開ツールの出力からのネットリストの簡約化に使用されます. 並列になった MOSFETやキャパシタをまとめあげる処理そしてオプショナルな機能として 小さいキャパシターを削除する処理を行います. 階層化された名前空間(.subckt/.ends や .alter ブロックなど) を改良、より多くのデバイス、.include/.model のサポートを予定してます. 他のプリプロセッサーとは異なり、コメント行や空行はその相対位置を保存します. そのため、出力されたネットリストは引き続く編集や処理のための可読性を保持しています.
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HDL のツール Topcased は編集や HDL ルールをチェックする専用のツールのセットです。
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Wedana (Web 電子設計自動化ネイティブ アプリケーション) する !JavaScript のフレームワークにより、エンド ユーザー アプリケーションを作成、編集、および何が Web ブラウザーを使用して電子回路図の表示すべての生産データは gEDA スイート形式に基づきますので、各ソフトウェアの間に簡単に交換することができます。
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libmls はスピーカーまたはお使いのコンピューターと、通常のサウンド カードを使用して部屋の周波数応答を測定するために使用できるライブラリです。それは、MLS (最大長順序) および副鼻腔スイープ測定を実行できます。ALSA や OSS、ウィンドウで使用するサウンド ・ システムをサポートしています。
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HTML 変換スクリプトに HDL VHDL や verilog HTML に変換されます。既定では、左側のメニュー バーと右手のソースの表示が作成されます。
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Pinapa は、GCC と SystemC ライブラリ自体に基づいて SystemC フロント エンドです。それは、アーキテクチャと SystemC プログラムの構文情報を抽出することができます。
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ドスンという音はサイクル ベースの設計のために最適化されたレジスタ転送レベル (RTL) シミュレーション環境です。設計は TH、1/0/x 演算子および階層的なインスタンス化をサポートするスキーム ベースのハードウェア記述言語 (HDL) で表されます。ドスンという音は、バッチ モードまたは対話型インターフェイスのいずれかを通じて、ライブラリとして使用できます。
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PySTDF は、Python モジュールを STDF (テラダインの標準的なテスト データ形式) で動作するように簡単です。STDF は、半導体テストで一般的に使用されるファイル形式です。自動テスト装置 (ATE) テラダイン、Verigy、LTX、信憑性、そのようなベンダーからこの形式をサポートします。PySTDF イベント ・ ベースのストリーム解析を提供します STDF バージョン 4、構造を助けるインデクサーのデータより便利な表形式フォームと行方不明概要レコードまたは派生レコードの新しいタイプを生成する能力に。パーサー アーキテクチャは非常に柔軟性と STDF バージョン 3 とカスタム レコードの種類をサポートする簡単に拡張することができます。
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An open source suite of circuit board design tools for Windows. Including schematic capture, board layout, and manufacturing file generation.
登録日: 2021-04-27 15:02
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