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CSV-Verilog Maker II
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プロジェクト概要
CSV-Verilog Maker IIはＣＳＶプリプロセッサ上で動作するプログラムです。
Excelで検証内容や設計内容を記載し、Verilogに変換するソースコード自動生成プログラムです。
システム要件
オペレーティングシステム: Windows 95/98/ME, Windows NT/2000
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CSV-CPU Maker II
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リリース時刻: 2017-03-05 21:27
1.07a
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リリース時刻: 2014-05-18 18:42
1.06
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リリース時刻: 2014-04-02 23:06
1.05
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リリース時刻: 2012-10-31 20:39
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1.00
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CSV-CPU Maker (Old Version)
(1 個のアイテム )
リリース時刻: 2009-05-17 17:28
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CSV-SystemC Maker II
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リリース時刻: 2017-03-05 21:26
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CSV-Verilog Maker II
(23 個のアイテム
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リリース時刻: 2017-03-05 12:56
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1.18
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1.15
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1.14
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1.13a
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CSV-Verilog Maker (Old Version)
(1 個のアイテム )
リリース時刻: 2009-05-17 17:30
1.00
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非表示
)
sample
(1 個のアイテム )
リリース時刻: 2009-06-22 18:41
20090622-1
(4 個のファイル
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)
SystemC Source Maker
(8 個のアイテム
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)
リリース時刻: 2013-09-06 23:07
1.08
(1 個のファイル
非表示
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リリース時刻: 2013-08-29 22:32
1.07
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リリース時刻: 2013-08-19 22:59
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リリース時刻: 2013-08-17 22:44
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リリース時刻: 2012-04-07 22:41
1.01
(1 個のファイル
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)
リリース時刻: 2012-03-25 21:11
1.00
(1 個のファイル
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verilog_model
(4 個のアイテム
表示
)
リリース時刻: 2012-06-03 19:49
1.03
(2 個のファイル
非表示
)
リリース時刻: 2012-05-05 18:39
1.02
(5 個のファイル
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)
リリース時刻: 2012-05-03 10:07
1.01
(2 個のファイル
表示
)
リリース時刻: 2012-04-16 14:22
1.00
(3 個のファイル
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)
Verilog Source Maker
(2 個のアイテム
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)
リリース時刻: 2014-07-12 23:14
1.01
(1 個のファイル
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リリース時刻: 2013-09-23 23:35
1.00
(1 個のファイル
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